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Novas 驗證流程強化

Laker 客製化IC設計

解決方案
Verdi Automated Debug
節省一半的偵錯時間

Siloti Visibility Automation
降低模擬資源耗費

Certitude
消除驗證中的不確定性

技術文章
Visualizing, analyzing and debugging SystemVerilog testbench environments
EDA DesignLine - May 2009

Functional qualification: A Technical Brief
EDA Design Line - Mar 2009

技術白皮書
SVTB 偵錯&分析

RTL 偵錯的先進技術

Laker 客製化IC設計

Novas 驗證流程強化

 

解決方案
Laker Custom Layout Automation System
事半功倍的卓越佈局結果

Laker Advanced Design Platform
開放式電路編輯、模擬、及偵錯環境

Technical Articles
Custom IC Design Automation - It's time to get practical
SCD Source - Jan 2009

Whitepapers
Laker 客製化佈局參數化元件

Laker製程設計套件(PDK)

最新消息

June 25, 2009
思源、台積電合作65奈米製程PDKs -- 電子時報

June 24, 2009
思源宣佈與台積電聯手開發尖端製程設計套件 -- EETimes

June 23, 2009
思源科技與台積電聯合開發多重技術節點的製程設計套件組合--EDN Taiwan

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活動訊息

August 18, 2009
Taiwan SCC 2009 - 新竹國賓大飯店

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